उच्च गति एफपीजीए में विभेदक ऑसिलेटर का अनुप्रयोग
विभेदक ऑसिलेटर का उच्च गति एफपीजीए डिज़ाइन में अत्यधिक महत्वपूर्ण अनुप्रयोग होता है, विशेष रूप से घड़ी की सटीकता, विरोधी हस्तक्षेप क्षमता और सिग्नल अखंडता के लिए उच्च आवश्यकताओं वाले सिस्टम में, जैसे:
उच्च गति सीरियल इंटरफ़ेस (PCIe, SFP+/QSFP, 10G ईथरनेट, DDR4/DDR5)
मल्टी-चैनल डेटा अधिग्रहण प्रणालियाँ
उच्च गति संचार प्रणालियाँ (SerDes)
परिशुद्धता तुल्यकालन प्रणाली (टाइमस्टैम्पिंग, एडीसी/डीएसी ड्राइविंग)
डिफरेंशियल ऑसिलेटर क्या है?
डिफरेंशियल ऑसिलेटर एक सक्रिय क्रिस्टल ऑसिलेटर है जो डिफरेंशियल सिग्नल (जैसे एलवीडीएस, एलवीपीईसीएल, एचसीएसएल) आउटपुट करता है, दो क्लॉक सिग्नल (सीएलके+ और सीएलके−) उत्पन्न करता है जो एक दूसरे के विपरीत होते हैं। यह पारंपरिक सिंगल एंडेड ऑसिलेटर्स (उदाहरण के लिए, CMOS - आउटपुट ऑसिलेटर्स) से भिन्न है।
विभेदक सिग्नल के लाभ:
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विशेषता |
विभेदक संकेत |
एकल-समाप्त सिग्नल |
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विरोधी-हस्तक्षेप क्षमता |
मजबूत (सामान्य-मोड शोर रद्दीकरण) |
कमज़ोर |
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सिग्नल की समग्रता |
अच्छा, उच्च गति सिग्नल संचारित करने में आसान |
गरीब |
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ड्राइविंग क्षमता |
उच्च, लंबी-दूरी/उच्च{{1}स्पीड ट्रांसमिशन के लिए उपयुक्त |
कम |
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जिटर प्रदर्शन |
निचला |
अपेक्षाकृत अधिक |
उच्च गति एफपीजीए में विभेदक ऑसिलेटर का अनुप्रयोग
उच्च गति इंटरफेस के लिए एक संदर्भ घड़ी के रूप में कार्य करना
PCIe, 10G/25G ईथरनेट और SATA जैसे उच्च गति इंटरफ़ेस को विभेदक संदर्भ घड़ियों का उपयोग करना चाहिए;
100 मेगाहर्ट्ज या 156.25 मेगाहर्ट्ज डिफरेंशियल ऑसिलेटर (उदाहरण के लिए, एचसीएसएल/एलवीडीएस आउटपुट) आमतौर पर उपयोग किए जाते हैं;
एफपीजीए के अंदर जीटीएक्स/जीटीएच/जीटीपी जैसे उच्च गति ट्रांसीवर मॉड्यूल (ट्रांससीवर्स) को इन अंतर संदर्भ घड़ियों की आवश्यकता होती है।
✅ विशिष्ट कनेक्शन:
डिफरेंशियल ऑसिलेटर → FPGA GTREFCLK0/1 (हाई-स्पीड ट्रांसीवर रेफरेंस क्लॉक पिन)
क्लॉक ट्री का कोर क्लॉक स्रोत
मल्टी{{0}चैनल हाई{{1}स्पीड सिस्टम में, एक डिफरेंशियल ऑसिलेटर एक क्लॉक डिस्ट्रीब्यूशन चिप (उदाहरण के लिए, SI5341/AD9528) चलाता है, जो फिर कई सिंक्रोनाइज़्ड घड़ियों को आउटपुट करता है;
बहु{{0}एडीसी, डीएसी, और एफपीजीए संचार में घड़ी संरेखण के लिए उपयुक्त।
✅ संरचना आरेख:
डिफरेंशियल ऑसिलेटर → क्लॉक मैनेजमेंट चिप (उदाहरण के लिए, पीएलएल / फैनआउट बफर)
↓
एकाधिक सिंक्रोनाइज़्ड घड़ियाँ → FPGA/ADC/DAC
एफपीजीए आंतरिक पीएलएल/एमएमसीएम ड्राइविंग
डिफरेंशियल ऑसिलेटर उच्च गुणवत्ता वाले क्लॉक इनपुट प्रदान कर सकते हैं (उदाहरण के लिए, IBUFDS इंटरफ़ेस के माध्यम से FPGA में प्रवेश करना), और आंतरिक PLL/MMCM फिर प्रत्येक सिस्टम मॉड्यूल के लिए क्लॉक आउटपुट करता है; इससे घड़ी की गुणवत्ता में सुधार होता है और समग्र सिस्टम घड़ी की घबराहट कम हो जाती है।
सामान्य विभेदक आउटपुट प्रकार और एफपीजीए संगतता
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उत्पादन का प्रकार |
विशिष्ट अनुप्रयोग |
एफपीजीए इंटरफ़ेस संगतता |
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एलवीडीएस |
सामान्य अंतर थरथरानवाला आउटपुट प्रकार |
सभी मुख्यधारा एफपीजीए (जीटीएक्स/जीटीएच इनपुट) द्वारा समर्थित |
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एचसीएसएल |
PCIe, सर्वर मदरबोर्ड में उपयोग किया जाता है |
सीधे समर्थित (उदाहरण के लिए, Xilinx PCIe IP कोर) |
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एलवीपीईसीएल |
उच्च-आवृत्ति, उच्च-स्विंग अनुप्रयोग |
बाहरी समाप्ति मिलान और पूर्वाग्रह प्रतिरोधकों की आवश्यकता है |
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सीएमएल |
Ultra-high-speed links (>10 जीबीपीएस) |
उच्च -अंत एफपीजीए ट्रांसीवर द्वारा समर्थित |
✔ एफपीजीए निर्माता द्वारा अनुशंसित मिलान किए गए अंतर आउटपुट प्रकार का उपयोग करने की अनुशंसा की जाती है।
विभेदक थरथरानवाला चयन के लिए सिफारिशें
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पैरामीटर |
अनुशंसित मूल्य |
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आवृत्ति स्थिरता |
±25 पीपीएम या बेहतर |
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चरण जिटर (12kHz-20MHz) |
< 1ps RMS (required for high-speed interfaces) |
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उत्पादन का प्रकार |
एफपीजीए अनुकूलता के आधार पर एलवीडीएस/एचसीएसएल को प्राथमिकता दी जाएगी |
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भार क्षमता |
ड्राइविंग क्षमता 15pF से अधिक या उसके बराबर या घड़ी चिप से मेल खाती है |
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तापमान की रेंज |
औद्योगिक ग्रेड (-40 डिग्री ~ +85 डिग्री) या उससे अधिक व्यापक |
प्रोटोकॉल को प्राथमिकता दें-अनुशंसित आवृत्तियाँ:
पीसीआईई: 100 मेगाहर्ट्ज;
एसएफपी+/10जी ईथरनेट: 156.25 मेगाहर्ट्ज;
25जी/40जी ईथरनेट: 312.5 मेगाहर्ट्ज;
जेईएसडी204बी/सी: 250 मेगाहर्ट्ज, 312.5 मेगाहर्ट्ज, 625 मेगाहर्ट्ज, आदि।
आधिकारिक FPGA दस्तावेज़ में अनुशंसित क्लॉक रेंज देखें;
कम घबराहट महत्वपूर्ण है:
आरएमएस जिटर <0.5 पीएस (उच्च-स्पीड इंटरफेस के लिए आवश्यक);
पीसीआईई, जेईएसडी204सी, और 10जी/25जी ईथरनेट के लिए विशेष रूप से महत्वपूर्ण।
✅ हाई{0}}स्पीड एफपीजीए में डिफरेंशियल ऑसिलेटर्स की सामान्य आवृत्तियाँ
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आवृत्ति (मेगाहर्ट्ज) |
अनुप्रयोग परिदृश्य |
टिप्पणी |
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100 |
PCIe Gen1/Gen2; सामान्य उच्च गति तर्क प्रणाली |
बहुत सामान्य, एचसीएसएल/एलवीडीएस का समर्थन करता है |
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125 |
गीगाबिट ईथरनेट |
GMII, SGMII जैसे इंटरफेस के लिए उपयुक्त |
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156.25 |
10G ईथरनेट (10GBASE-R/XAUI), SFP+, QSFP, CEI इंटरफ़ेस, आदि। |
उच्च गति धारावाहिक संचार के लिए मानक आवृत्ति |
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200 |
DDR4 घड़ी, मल्टी-रेट ट्रांसीवर संदर्भ आवृत्ति |
आमतौर पर उच्च घड़ियां उत्पन्न करने के लिए आवृत्ति गुणन के लिए उपयोग किया जाता है |
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212.5 |
जेईएसडी204बी/सी डेटा रूपांतरण लिंक |
उच्च-आवृत्ति अधिग्रहण संचार इंटरफेस के लिए मानक आवृत्ति |
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250 |
उच्च गति वाले ADC/DAC सिस्टम, कुछ JESD204C सिस्टम |
कठोर घबराहट आवश्यकताएँ |
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312.5 |
25G ईथरनेट (25GBASE-R), उच्च{{3}स्पीड ऑप्टिकल संचार प्रणाली |
विभेदक आउटपुट अक्सर CML/LVPECL होता है |
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322.265625 |
सीपीआरआई (6.144 जीबीपीएस) संदर्भ घड़ी |
संचार बेस स्टेशन FPGAs में उपयोग किया जाता है |
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644.53125 |
सीपीआरआई (12.288 जीबीपीएस), जेईएसडी204सी उच्च गति लिंक |
अल्ट्रा{{0}हाई{{1}स्पीड इंटरफेस, अल्ट्रा{2}लो जिटर ऑसिलेटर की आवश्यकता होती है |
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अन्य (उपयोगकर्ता-परिभाषित) |
लक्ष्य आवृत्ति उत्पन्न करने के लिए पीएलएल में विशिष्ट आवृत्ति इनपुट |
गुणन कारक के लिए पीएलएल समर्थन की पुष्टि करने की आवश्यकता है |
✔ विशिष्ट मॉडलों के लिए, मिलान किए गए अंतर आउटपुट प्रकार की अनुशंसा के लिए हैंगजिंग सेल्स या तकनीकी इंजीनियरों से संपर्क करने की अनुशंसा की जाती है।
सारांश
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वस्तु |
डिफरेंशियल ऑसिलेटर्स के लाभ |
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शुद्धता |
कम घबराहट, स्थिर आवृत्ति |
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विरोधी-हस्तक्षेप |
मजबूत, अच्छा सामान्य -मोड शोर दमन |
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रफ़्तार |
गीगाहर्ट्ज़-स्तर उच्च{{1}स्पीड ट्रांसमिशन का समर्थन करता है |
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आवेदन |
PCIe, SFP, DDR4/5, ADC, DAC, सिंक्रोनाइज़ेशन सिस्टम, आदि। |
डिफरेंशियल ऑसिलेटर आधुनिक उच्च गति एफपीजीए सिस्टम में लगभग एक मानक घटक हैं और सिस्टम के उच्च गति संचार और सिंक्रनाइज़ेशन प्रदर्शन को सुनिश्चित करने वाले प्रमुख उपकरण हैं।
यदि आपके पास एक विशिष्ट FPGA मॉडल (जैसे Xilinx Zynq Ultrascale+, Intel Stratix 10), डिफरेंशियल ऑसिलेटर मॉडल, या संचार इंटरफ़ेस आवश्यकता (जैसे PCIe Gen3/SFP+) है, तो सूज़ौ हैंगजिंग आपको सबसे उपयुक्त घड़ी कॉन्फ़िगरेशन योजना और योजनाबद्ध कनेक्शन डिज़ाइन की अनुशंसा करने में मदद कर सकता है।